Apple Les M5 Pro, Max et Ultra pourraient abandonner l'architecture de mémoire unifiée tant vantée pour des conceptions séparées de CPU et de GPU fabriquées sur TSMC N3E

Apple n'a annoncé que récemment le nouveau MacBook Pro 14 et MacBook Pro 16 avec M4 Pro et M4 Max Les deux premiers SoC sont déjà en cours de développement, mais nous commençons déjà à savoir ce qui pourrait se passer pour la prochaine gamme M5, l'année prochaine.

Cette information nous est communiquée par Ming-chi Kuo, analyste réputé de la chaîne d'approvisionnement, qui a prédit certains développements concernant la prochaine série de puces M5 de Apple.

Selon Kuo, la série M5, composée du M5 de base, du M5 Pro, du M5 Max et du M5 Ultra, sera fabriquée sur le nœud N3P de TSMC, dont le prototype a été réalisé il y a quelques mois. La série M4 utilisée dans les derniers Mac et les processeurs A18 / A18 Pro utilisés dans l iPhone 16 sont fabriqués selon le procédé N3E de TSMC, qui est lui-même une révision du procédé N3B révision du processus N3B que les A17 Pro a été fabriqué.

Kuo prévoit que la série M5 entrera en production au premier semestre 2025 et au deuxième semestre 2025, et que le M5 Ultra commencera en 2026.

L'analyste indique également que les puces M5 Pro, Max et Ultra utiliseront un emballage TSMC 2,5D de qualité serveur appelé System on integrated chips-molding Horizontal (SoIC-mH). SoIC-mH permet à Apple de séparer les conceptions de CPU et de GPU tout en améliorant les rendements et les températures.

SoIC est en fait la version de TSMC de l'empilage 3D et du collage hybride des plaquettes. L'avantage du collage hybride est qu'il permet des connexions ultra-denses et ultra-courtes entre deux plaquettes. SoIC-X est une variante de la technologie actuellement utilisée dans le 3D V-cache d'AMD.

Il est intéressant de noter que Kuo mentionne SoIC-mH comme une technologie 2,5D, ce qui pourrait signifier que les piles 3D sont collées horizontalement au moyen d'un emballage CoWoS ou InFO. Alors que le SoIC-X ( ) est sans bosse, le SoIC-P est sans bossesoIC-P est un emballage bosselé qui permet d'empiler une puce N3 sur une puce N4 ou supérieure dans une orientation face à dos (F2B).

Un autre aspect intriguant est la conception séparée du CPU et du GPU. Si cela est vrai, cela signifie essentiellement que le M5 n'utilisera pas d'architecture de mémoire unifiée (UMA) partagée entre le CPU et le GPU. L'UMA est une caractéristique du silicium Apple et l'une des principales raisons de ses performances et de son efficacité énergétique. L'argument corollaire serait donc de savoir si cette nouvelle conception divisée se traduit réellement par des gains de performance dans le monde réel sans augmentation conséquente du TDP.

Ceci étant dit, une telle conception peut aider à améliorer l'inférence de l'IA. À ce titre, le Private Cloud Compute (PCC) de Apple devrait être le plus grand bénéficiaire des modèles M5 haut de gamme.

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